AI 芯片与前沿
未来怎么破：痛点、解法与预测
CoPoS、玻璃基板、3.5D、定制 HBM、背面供电、微流道冷却、CPO、SoW-X：各自解决哪个痛点，进度如何，以及我的预测。
未来
未来怎么破：痛点与解法，以及我的预测
每一个痛点，业界都已经有对应的方向，差别在于成熟度。下图把它们画在一颗“2030 年左右的 AI 芯片”里，编号对应下面的表格。
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| # | 痛点 | 解法 | 现在进度（2026 年 10 月） | 我的预测 |
|---|---|---|---|---|
| 1 | ① 尺寸、圆晶圆浪费 | CoPoS：中介层改在方形面板（初期 310×310 mm）上做；之后面板可能更大 | 试产线 2026 年建成；量产据报 2028 年底至 2029 年初，NVIDIA 预计首发 | 把握高2029 年起旗舰 AI 芯片逐步转向面板；圆晶圆 CoWoS-L 仍会并存多年 |
| 2 | ② 翘曲 | 玻璃芯基板：玻璃的 CTE 可以调到接近硅，又平又硬，还能打更细的孔（TGV） | Intel、三星、SKC（Absolics）等在试产；供应链未成熟 | 把握中2028–2030 年先进入最高端产品；短期内靠加强环、低 CTE 材料、分拆封装过渡 |
| 3 | ⑦ 海岸线、带宽密度 | SoIC 混合键合 + CoWoS（3.5D）：计算芯片叠在缓存/IO 芯片上，再放上中介层 | AMD MI300 已量产；NVIDIA 等正在导入 | 把握高2027–2028 年起旗舰 GPU 普遍“先 3D 叠，再 2.5D 拼” |
| 4 | ⑤ 内存墙、HBM 良率 | HBM4/4E 定制底层芯片、混合键合 HBM：层数到 16–20 层，部分逻辑功能下放到 HBM 底层 | HBM4 2026 年量产，底层芯片由台积电代工 | 把握中高HBM4E/HBM5 世代转向混合键合；更远期出现内存直接叠在逻辑上 |
| 5 | ④ 供电 | 背面供电（台积电 A16）、封装内稳压器（IVR）、中介层内嵌电容（eDTC）、更高电压直送 | A16 2026 年下半年量产；eDTC 已用于 CoWoS-L | 把握高“把电压转换尽量挪到芯片正下方”会成为标配 |
| 6 | ③ 散热 | 液冷冷板 → 芯片内微流道、两相冷却 | 冷板液冷已是标配；微软 2025 年展示芯片内微流道原型 | 把握中2030 年前后微流道进入少数旗舰；在那之前功耗墙会限制单封装规模 |
| 7 | ⑧ 封装外互连 | 共封装光学（CPO）：把光引擎放进封装，电信号在毫米内转成光（台积电 COUPE） | 交换机 CPO 2025–2026 年开始出货 | 把握中2028 年前后出现带光 I/O 的 GPU 封装；铜线退守机柜内短距离 |
| 8 | ① 尺寸（终极） | SoW-X 晶圆级系统：整片晶圆当一颗芯片用 | 台积电规划 2027 年量产 | 把握中低会有客户采用，但测试、散热、维修太难，不会取代主流封装 |
| 9 | ⑥ 产能 | 封测厂分担 + 多元化：日月光、Amkor 承接后段；Intel EMIB-T 等成为第二来源 | 非台积电产能 2026 年约 5–6 万片/月（估计） | 把握高供需缺口 2027 年后明显缩小，瓶颈转移到 HBM、电力与散热 |
我的整体判断
短期（2026–2027）：CoWoS-L 继续放大到 5.5–9 倍光罩，但翘曲和功耗会让“越做越大”变得越来越不划算。Rubin Ultra 的传闻就是一个信号：单个封装的规模第一次碰到了物理硬墙。
中期（2028–2030）：竞争焦点从“做多大”转向“叠多高、多平、多凉”。面板（CoPoS）解决尺寸和成本，玻璃基板解决翘曲，混合键合解决带宽密度，CPO 解决出封装的距离。四者大概率会在 2030 年前后汇合到同一颗旗舰芯片上。
长期：“封装”和“芯片制造”的界线会消失。晶圆厂负责的工序越来越往后延伸，封装决定的性能比例越来越高。将来比较 AI 芯片时，人们问的可能不再是“几纳米”，而是“怎么封的”。
以上预测基于截至 2026 年 10 月的公开报道和路线图，属于个人判断，供学习参考，不构成任何投资建议。
全文一张纸总结
- 芯片受限于光罩尺寸、良率和内存带宽，单靠缩小晶体管已经不够。
- CoWoS 在芯片和基板之间加了一层硅中介层，让多颗芯片和 HBM 像一颗芯片一样高速互连。
- 流程是先 CoW（芯片上晶圆）再 oS（上基板），难在几十万个焊点和多次热循环。
- S 用整块硅（密但小）、R 用有机 RDL（便宜但疏）、L 在 RDL 里嵌硅桥（大且密，当今主流）。
- 当前限制：尺寸、翘曲、散热、供电、良率叠加、产能、海岸线、封装外互连。
- 未来方向：面板化、玻璃基板、3D 混合键合、定制 HBM、背面供电、微流道冷却、共封装光学。